40nm BSI CMOS Image Sensor预览

RF Plasma

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HKD/AR1 AlO deposition

HKD/AR2 TaO deposition
298Oxide hard mask deposition299Pre Litho Cleaning300Backside Passivation Implant Mask Lithography301Back Passivation Ion Implantation302Ashing & Strip/Clean303Oxide hard mask etch304Vacuum Bake305Rapid Thermal Processing306RF Plasma307HKD/AR1 AlO deposition308HKD/AR2 TaO deposition309BPMD SiO Deposition

工艺截面图

ISP WaferCIS Wafer · BacksideBKPAS · K10 · HKD/AR1 AlO Deposition (High-k)AlOP+ implanted regionSiCESLSiO2CuTaAlSiN

本步要点

化学钝化发生在沉积的 AlO——或在初始沉积循环期间形成的超薄界面氧化物——满足硅悬挂键需求时,从而降低界面陷阱密度 。

原理展开

HKD/AR1 AlO 沉积步骤是背照式(BSI)CMOS 图像传感器中至关重要的背面钝化工艺 。在 BSI 架构所需的衬底减薄工艺之后,暴露出的背面硅表面极易产生结构缺陷和悬挂键,这些缺陷会成为严重的产生-复合中心 。继前序用于清洁和调节表面的 RF 等离子体步骤之后 ,沉积氧化铝(Al₂O₃)层以对这些表面缺陷进行电学钝化 。此外,该 AlO 层作为高 k 多层堆叠的第一层(AR1),为后续的 TaO 沉积奠定了基础,从而形成优化的

减反射光学界面 。该 AlO 层的核心功能依赖于由化学钝化和场效应钝化组成的双重钝化机制 。化学钝化发生在沉积的 AlO——或在初始沉积循环期间形成的超薄界面氧化物——满足硅悬挂键需求时,从而降低界面陷阱密度 。同时,场效应钝化由自然结合在硅界面附近 Al₂O₃ 薄膜内的高密度固定负电荷驱动 。这些负电荷在结构上归因于非化学计量界面区域内多余的间隙氧或铝空位 。根据半导体静电学原理,这种负电荷会诱导局域能带弯曲,从而在静电上将少数载流子排斥远离界面,显著降低表面复合速率并抑制暗电流的产生 。原子层沉积(ALD)或等离子体增强原子层沉积(PEALD)非常适合该步骤,因为其循环的、自限制的反应提供了亚单层厚度控制,并能在微粗糙表面上实现完美的台阶覆盖性 。选择 Al₂O₃ 而非其他高 k 材料,是因为它具有稳健的负固定电荷密度,以及适用于减反射应用且兼容的折射率 。ALD 过程中氧前驱体的选择直接调节了薄膜密度、氢掺入量以及由此产生的固定电荷量级 。平衡这些参数至关重要;例如,虽然更强的氧化剂可以增加固定电荷,但它们可能会改变最大限度减少界面陷阱所需的精细界面化学键合 。在 40nm BSI CIS 制造中,激进缩小的像素尺寸显著降低了满阱容量,并使传感器对微小的漏电流高度敏感 。因此,必须最大化 AlO 层的场效应钝化,以在低光照条件下保持可接受的信噪比 。AlO 与后续高 k 材料的集成,确保了钝化堆叠能够同时满足严格的光学透射率和电学可靠性要求 。

风险与挑战

  • [High] 界面陷阱导致的暗电流偏高:不完全的化学钝化会在 Si/AlO 界面留下高密度的悬挂键,这些悬挂键作为 Shockley-Read-Hall 产生中心,导致像素暗电流升高 。如果初始 ALD 循环未能形成足够的界面键合网络,削弱了对表面复合的抑制作用,就会发生这种情况 。
  • [Medium] 薄膜起泡与分层:在随后的热处理步骤中,捕获在 Al₂O₃/Si 界面附近的氢或水副产物可能会释气并积聚 。这种挥发性积聚会产生局部压力,克服薄膜的附着力,导致起泡或灾难性的薄膜分层 。
  • [Medium] 等离子体诱导的表面损伤:如果沉积工艺利用直接或能量过高的等离子体源来提高前驱体反应活性,离子轰击可能会在物理上损坏脆弱的硅表面 。这种退化表现为氧空位增加和结构无序,从根本上限制了钝化层的界面态降低能力 。

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相关步骤

  • Oxide hard mask deposition
  • Pre Litho Cleaning
  • Backside Passivation Implant Mask Lithography
  • Back Passivation Ion Implantation
  • Ashing & Strip/Clean
  • Oxide hard mask etch