40nm BSI CMOS Image Sensor预览

Ashing & Strip/Clean

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Final Inspection

FABOUT
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工艺截面图

ISP WaferBond Pad (M7 Al)CIS Wafer · BacksideWFR · W12 · Final Inspection (BSI Wafer Complete)Grid SealWTiNBPMDTaOAlOP+ implanted regionSiCESLSiO2CuTaAlLensProtective OxideOrgGBRCyUpper SealOptical Pad 3Lower OCLSiNSiONOptical Pad 1

本步要点

虽然扫描电子显微镜(SEM)提供了审查微观短路和开路所需的纳米级分辨率,但其较慢的扫描速度限制了其仅能用于目标缺陷复检,而无法用于全晶圆扫描 。

原理展开

终检(Final Inspection)是晶圆制造流程中,在晶圆通过 FABOUT 步骤转入封装之前的最终质量保证检查节点(工程实践)。该步骤位于键合焊盘(bond pad)阻挡层刻蚀及剥离/清洗模块之后,旨在验证外露键合焊盘及周围终端钝化层的完整性 。其主要目标是量化制造缺陷,这是集成电路制造中导致良率下降的主要原因 。通过在晶圆离开晶圆厂之前拦截结构性、电学和外观上的异常,该步骤可防止缺陷芯片消耗昂贵的后端封装资源

。

该检测依赖于多种互补的物理机制,主要是光学散射和电子显微镜技术 。高通量光学扫描系统通过将捕获的芯片图像与相邻参考芯片或数字化芯片设计数据库进行比较来运行,并将光学偏差标记为事件,以便进行后续的软件驱动模式识别 。为了在不造成物理破坏的情况下评估三维结构变化,光学关键尺寸(OCD)量测利用了光谱穆勒矩阵(Mueller Matrix)椭偏仪 。该技术利用入射偏振光与周期性纳米结构相互作用时产生的偏振态变化;几何形状的变化会改变衍射光的振幅、相位和偏振耦合 。通过使用严格耦合波分析(Rigorous Coupled-Wave Analysis),将测量到的光谱穆勒矩阵与预先计算的多层物理模型进行严谨拟合,系统能够精确地将关键尺寸偏差与底层工艺漂移区分开来 。此外,通过光的反射和散射来分析顶层互连的缺陷,其中形貌的变化预示着潜在的图形坍塌或缺失特征 。

检测方法的选择涉及晶圆吞吐量与空间分辨率限制之间的基本权衡 。虽然扫描电子显微镜(SEM)提供了审查微观短路和开路所需的纳米级分辨率,但其较慢的扫描速度限制了其仅能用于目标缺陷复检,而无法用于全晶圆扫描 。因此,首选光学系统进行初始的高采样率检测,随后进行有针对性的在线 SEM 复检或聚焦离子束(FIB)截面分析,以确定已识别缺陷的物理根本原因 。此外,验证键合焊盘表面质量至关重要,因为来自先前刻蚀和去胶步骤的残留氧化物、氢氧化物和氟化物会严重降低引线键合能力并增加接触电阻 。现代过程控制越来越多地采用非破坏性椭偏技术,而非仅仅依赖破坏性的截面分析,以验证焊盘表面及周围电介质是否符合其预期的光学常数和厚度 。

对于 40nm BSI CMOS 图像传感器而言,器件几何尺寸的微缩要求量测技术能够表征深亚微米和纳米级特征 。在此尺寸下,传统的 CD-SEM 测量仅限于顶面分析,且存在通过高能电子反应导致致命材料损伤的风险 。因此,非破坏性光学散射测量成为必不可少的工具,能够实现对整个目标结构及其下层结构的表征,并提供更大的样本覆盖范围 。这种全面的缺陷和尺寸映射对于确保从缺陷角度考虑的合格线良率,以及从器件角度考虑的整体制造良率至关重要 。

风险与挑战

  • [高] 焊盘污染与腐蚀:前道阻挡层刻蚀和去胶工艺中残留的氟化物、氧化物或氢氧化物可能无法完全去除,在焊盘上形成非金属或半金属钝化层 。这些层会在后续封装步骤中物理阻隔原子直接扩散,导致接触电阻升高、引线键合性能不佳以及空洞形成 。
  • [高] 未检出的系统性 BEOL 缺陷:在先前的双大马士革(dual-damascene)工艺中产生的图形坍塌、互连短路或开路可能会贯穿各层,并在顶层表现出来 。如果光学检测系统的图形识别软件因图像对比度不足或参考数据库不匹配而未能标记这些缺陷 ,有缺陷的晶粒(die)将被错误地送往封装环节,从而直接导致良率损失 。
  • [中] 量测导致的材料损伤:在密集的 SEM 缺陷复核过程中,长时间暴露在高能电子束下可能会引发局部化学反应或电荷效应 。这种相互作用会损坏敏感的表面材料或薄电介质,可能在测量点产生原本不存在的致命电学缺陷 。
  • [低] 虚假缺陷标记(过度报告):局部薄膜厚度或折射率的变化可能导致椭偏仪或光学散射测量信号发生偏移,从而模拟真实的物理缺陷 。如果预先计算的多层光学模型没有充分考虑这些良性工艺波动 ,系统可能会将这些光学偏差解释为结构性缺陷,从而导致不必要的人工复核负担和虚假良率损失 (工程实践)。

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相关步骤

  • Wafer In
  • WF Laser markings
  • Particle Removal
  • Oxidation Pre-Cleaning
  • Oxide growth
  • Nitride deposition